该体系可以完结图画的收集、处理和显现，然后完结方针辨认与盯梢的智能信号处理。该体系是对摄像机数字，模仿两路视频数据进行收集，处理后通过PCI总线在PC机上显现出来。
视频信号收集模块
摄像机供给两路视频信号：一路模仿视频，一路数字视频。
模仿视频信号通过钳位校对、扩大后，将信号送入到A/D转化器，再经FPGA锁存后将视频信号发送给DSP1；经视频同步别离电路，由LM1881别离出模仿视频的行、场同步信号，用于操控视频数据收集到DSP1，以便进行图画处理。钳位校对、视频同步电路如图1所示。模仿视频经运放输入，将中心电平调到3.3V，加到 A/D输入端。A/D转化后的数据进入FPGA锁存。运放均选用ADI公司的AD8047AR，A/D转化器选用ADI公司的AD9050。AD9050 为10位A／D转化器，取其高8位进入FPGA。采样时钟12MHz，与数字视频信号相同。由FPGA对48MHz时钟四分频发生。
图1 模仿视频输入转化电路
摄像机的数字视频信号为14对差分信号，经FPGA将差分信号转化为单端信号，并锁存数据。每个象素14位，每帧320×240。
FPGA选用ALTERA公司的CYCLONE系列EP1C3T144C-6，装备芯片选用EPC2LC20。EP1C3T144C-6具有将差分信号转单端信号的专用I/O口。锁存在FPGA的数字，模仿两路视频信号依据作业形式挑选输出到DSP1数据总线上，由DSP1读入处理，数据速率与模仿视频的采样速率，数字视频的数据速率相同。作业形式挑选，开关操控通过PIC9054引进到FPGA。
DSP处理器模块
DSP处理器阵列模块主要由4片高速高功用的DSP处理芯片ADSP-TS201S组成多DSP处理器体系，ADSP-TS201S功用如下：
根本功用指标如下：
● 600MHz运转速度时，内核指令周期1.67ns
● 24M bits片上DRAM，分为6个4M bits块（128K words X 32 bits）
● 片内双运算模块，每个都包括一个ALU、一个乘法器、一个移位器和一个寄存器组
● 双整数ALU供给数据寻址和指针操作功用
● 片内供给14通道DMA、外部口、4个链路口、SDRAM操控器、可编程标志引脚、2个定时器
● 片上裁定体系可完结8个TigerSHARC DSP的无缝衔接
● 内部3条相互独立的128位总线
● 外部数据总线64位，地址总线32位
● 每秒48亿次40位宽的MAC运算或每秒12亿次80位宽的MAC运算；1024点复数FFT（基2）时刻15.7us
● 外部端口 1G字节每秒；链路口（每个）1G字节每秒
DSP处理器阵列模块中DSP1是用来收拾所收集到的视频信号，并进行相应的预处理后，将数据分发送到后边的DSP，进行进一步的处理。
DSP1并行口应接FPGA输出的视频数据，还要接FLASH，完结DSP加载。DSP1的IRQ0，IRQ1别离作视频输入的帧中止和行中止，接到FPGA。其衔接电路如下图3所示。
图2DSP1与FPGA，FLASH 衔接图
矩阵切换器电路
下面介绍的是容量为32路音视频的监控，为简化规划，及调试、装置、晋级等的便利，32路音视频不在一块PCB板上处理，而是分红4块子板，每块子板处N8路音视频，完结8路音视频通道的8选1输出功用，即4块子板组成一个矩阵切换器，在同一时刻完结32选4输出功用。每块子板的电路图如图3所示。
图3 矩阵切换器电路
在图中，J1…J8为继电器线圈，用双刀双掷继电器J4078完结音视频的一起切换。J11、J12为跳线插座，该跳线为子板设置地址，当设置的子板地址与主操控器的子板挑选地址（A0、A1、A2）相一起，该子板块的4099处于作业状况，这时，再通过主操控器的通道挑选指令（cmd0、 cmd1、cmd2）使J1…J8中任一继电器完结切换动作，完结某一路音视频的一起选通。
语音信号收集与处理电路
由于要收集教室各个方位（一般在20～50m2范围内）的语音信号，运用一般的话筒扩大电路明显达不到要求。本体系选用对数扩大电路进行语音扩大，比较明晰地收集到了50m2范围内各个方位的语音信号。规划的对数扩大电路如图所示。%&&&&&%2为运算扩大器，体系选用LM358完结二级运算扩大。
图4 语音信号收集与处理电路
使用传感技能和电子技能体系规划思路简略、本钱低价、便利有用。对进步学生自主学习的自觉性，监控自主学习设备和软件渠道运转状况，避免人为损坏形成的不必要丢失，进步设备运转的安稳性和可靠性等起到了非常重要的作用。
修改点评：本文简略介绍了模仿视频监控收集电路的规划，模仿视频信号通过钳位校对、扩大后，将信号送入到A/D转化器，再经FPGA锁存后将视频信号发送给DSP1。可以完结图画的高速处理，完结图画的实时显现，方针盯梢。在实践使用中该体系作业安稳，到达料想作用。
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