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新思科技推出全新64位ARC处理器IP

新思科技今天宣布推出面向高性能嵌入式应用的全新DesignWare® ARC® HS5x和HS6x处

新思科技今日宣告推出面向高功用嵌入式使用的全新DesignWare® ARC® HS5x和HS6x处理器IP系列。32位ARC HS5x和64位HS6x处理器有单核和多核版别,选用一种新的超标量ARCv3指令集架构(ISA),在典型条件下,可在16纳米工艺技能中完成高达8750 DMIPS的单核功用,是现在功用最高的ARC处理器

新款ARC HS处理器的多核版别包含一个立异的互连结构,可衔接多达12个中心,支撑多达16个硬件加速器的接口,一起坚持中心之间的一致性。这些处理器可装备用于实时运转,或装备支撑对称多处理(SMP) Linux和其他高端操作体系的高档内存办理单元(MMU)。为了加速软件开发,ARC HS5x和HS6x处理器由ARC metaWare开发东西套件供给支撑,可生成高效代码。新款ARC HS处理器可满意各种高端嵌入式使用的功耗、功用和面积要求,包含固态硬盘(SSD)、轿车操控和信息文娱、无线基带、无线操控和家庭网络。

忆芯科技首席科学家Bruce Cheng表明:“高端嵌入式使用的规划人员在继续的压力下,需求在有限的功耗和面积预算内添加内存空间,一起完成更高的功用。新思科技新推出的32位ARC HS5x和64位HS6x处理器的多核功用,使咱们可以将功耗与功用功率提升至全新水平,这是现在市场上的其他处理器无法供给的。”

The Linley Group高档剖析师Mike Demler表明:“网络、存储和无线设备等高端嵌入式体系变得越来越杂乱,需求在不影响能效的前提下增强处理器功用和功用。新思科技新推出的ARC HS5x和HS6x CPU不只可以满意这些需求,也供给了支撑未来嵌入式体系所需的可装备性和可扩展性。”

ARC HS5x和ARC HS6x处理器根据新的ARCv3 ISA,支撑各种32位和64位指令。这些处理器具有高速10级、双发射流水线,在功耗和面积有限的情况下进步了功用单元的利用率。HS5x处理器的32位流水线可以履行一切ARCv3 32位指令,而HS6x处理器的64位流水线和寄存器文件可以履行32位和64位指令。此外,ARC HS6x支撑64位虚拟地址空间和52位物理地址空间,可以直接寻址当时和未来的大内存,并支撑128位加载和存储,以完成高效的数据移动。ARC HS5x和HS6x处理器的多核版别都包含先进的高带宽处理器内部互连,经过异步时钟和高达800 GB/s的内部聚合带宽来简化开发和时序收敛。为了进一步简化多核装备中的物理规划和时序收敛,每个核坐落自己的功率域中,而且与其他核具有异步时钟联系。新的128位矢量浮点单元支撑F16、F32和F64操作,具有2个周期的累积推迟。跟一切ARC处理器相同,HS5x和HS6x处理器都高度可装备,并选用ARC Processor EXtension (APEX)技能,支撑自定义指令,可满意每个方针使用的共同功用、功耗和面积要求。

HS5x和HS6x处理器由新思科技的ARC metaWare开发东西套件供给支撑,其间包含一个针对处理器超标量架构进行优化的高档C/C++编译器,一个用于调试和剖析代码的多核调试器,以及一个用于硬件前软件开发的快速指令集模仿器(ISS)。周期准确的模仿器可用于规划优化和验证。处理器的开源软件支撑包含Zephyr实时操作体系、优化的Linux内核、GNU编译器调集(GCC)、GNU调试器(GDB)和相关的GNU编程实用程序(二进制东西)。第三方合作伙伴供给了其他硬件和软件东西,使开发人员可以灵敏地为其规划项目选择最好和最了解的东西。

新思科技IP营销与战略高档副总裁John Koeter表明:“固态硬盘、无线操控和家庭网络等嵌入式使用正变得越来越杂乱,需求在有限的功耗和面积预算内明显进步功用。跟着全新ARCv3 ISA的发布以及ARC HS5x和HS6x处理器的推出,规划人员可以满意当今和未来嵌入式规划日益增长的功用需求。”

上市和资源

DesignWare ARC HS5x和HS6x处理器定于2020年第三季度上市。新款处理器将包含ARC HS56、HS57D、HS58、HS66、HS68和各自的多核版别(HS56MP、HS57DMP、HS58MP、HS66MP、HS68MP)。

DesignWare IP核简介

新思科技是面向芯片规划供给高质量的经芯片验证的IP核解决方案的抢先供货商。DesignWare IP核组合包含逻辑库、嵌入式存储器、嵌入式测验、模仿IP、有线和无线接口IP、安全IP、嵌入式处理器和子体系。为了加速原型规划、软件开发以及将IP整合进芯片,新思科技IP Accelerated方案供给IP原型规划套件、IP软件开发套件和IP子体系。新思科技对IP核质量的广泛出资、全面的技能支撑以及强壮的IP开发办法使规划人员可以下降整合危险,并加速上市时刻。

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