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简略的JK触发器的VHDL程序

2020年9月19日 18:23 阅读(354)

简单的JK触发器LIBRARYIEEE;USEIEEESTD_LOGIC_1164ALL;ENTITYJKff_1ISPORT(J,K:INSTD_LOGIC;clk:INstd_logic;Q:

简略的JK触发器
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
ENTITY JKff_1 IS
PORT (J,K:IN STD_LOGIC;
clk : IN std_logic;
Q: out STD_LOGIC);
end JKff_1;
ARCHITECTURE behave OF JKff_1 IS
signal S:STD_LOGIC;
BEGIN
S<= (J and (not S)) or (S and (not K)) when clkevent and clk=0 ;
Q<=S ;
end behave;